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  1. mcu_led2

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  2. 基于vivado平台,使用microblaze搭建一个小系统,并能点亮led(Based on the vivado platform, the use of MicroBlaze to build a small system, and can light LED)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-18
    • 文件大小:66.33mb
    • 提供者:D蒙
  1. main

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  2. 嵌入式系统加密的FPGA实现源码,可直接用于工程(Embedded system encryption FPGA implementation source code, can be used directly for the project)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-18
    • 文件大小:3.24mb
    • 提供者:松哥HIT
  1. FPGA-频率计(等精度测频+SPI通信)

    0下载:
  2. 本程序采用FPGA编程,实现等精度测频的程序,并且有实现SPI通信的程序。(This procedure uses FPGA programming, such as precision frequency measurement procedures, and to achieve SPI communication procedures.)
  3. 所属分类:VHDL/FPGA/Verilog

  1. F0501

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  2. 汽车VCU控制器测试工装的程序,STM32单片机扩展总线读写FPGA内部RAM,DDS方式产生PWM,PWM频率,脉宽测量功能(Automotive VCU controller test tooling procedures, STM32 microcontroller expansion bus read and write FPGA, the internal RAM, DDS way to generate PWM, PWM frequency, pulse width measurem
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-21
    • 文件大小:7.32mb
    • 提供者:nan211
  1. ad

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  2. 这是用vhdl语言实现ad转换的源码,用quartus实现。(ad transform using vhdl)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:658kb
    • 提供者:JJJJJJJJJ
  1. m60component20161109

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  2. 用verilog语言实现的模为60的计数器,经编译合格,利用quarter2及以上可以直接使用,并使用了分块模式(Using Verilog language to achieve the modulus of 60 counters, compiled by qualified, using quarter2 and above can be used directly, and the use of sub block mode)
  3. 所属分类:VHDL/FPGA/Verilog

  1. m60v20161109

    0下载:
  2. 用verilog语言实现的模为60的计数器,经编译合格,利用quarter2及以上可以直接使用(Using Verilog language to achieve the modulus of 60 counters, compiled by qualified, using quarter2 and above can be used directly)
  3. 所属分类:VHDL/FPGA/Verilog

  1. adder

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  2. 实现四位加法器,适合初学者学习VHDL语言(it's an addler of four bits which is designed for the new designer of VHDL)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:85kb
    • 提供者:秦秦秦
  1. ARINC429航空总线协议标准

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  2. 429总线,协议及相关介绍,机载航电设备通讯总线(FPGA implementation ARINC429 protocol using verilog HDL to do a complete ARINC429 communication transceiver protocol,)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-17
    • 文件大小:346kb
    • 提供者:shukuang
  1. dds(1)

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  2. 基于DDS的信号发生器设计。DDS,FPGA,Verilog。(Design of signal generator based on DDS.DDS,FPGA,Verilog.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-23
    • 文件大小:10.51mb
    • 提供者:电磁驱动
  1. dean_1497192314538

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  2. LINUX编程方面的资料,我只是为了下载才这个的(NOsjfjksdhfsdhfjsdhfkjsdhfjsdh)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:124kb
    • 提供者:ghosnp
  1. yunpai_v70

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  2. Using weighted model nodes in the network strength and weight are power law distribution, The IMC - PID is using the internal model control principle for PID parameters is calculated, DC-DC power single-part set-loop control.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-25
    • 文件大小:5kb
    • 提供者:nqppurtc
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