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  1. nios2irq

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  2. 实现FPGA板上用按钮(外部中断)控制led的亮灭-Implement on FPGA board with button (external interrupt) control the led light out
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.74mb
    • 提供者:wu
  1. vhdl

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  2. vhdl基础教程,里面详细讲述了语法要求,还有实例,很适合初学者学习。-vhdl tutorial basis, which describe in detail the syntax requirements, as well as examples, it is suitable for beginners to learn.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.76mb
    • 提供者:money
  1. AD7606_1

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  2. ad7606采集Verilog 编写的模块 有仿真图(ad7606 Verilog ad7606 Verilog)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-18
    • 文件大小:15.77mb
    • 提供者:maymumu
  1. shiboqi

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  2. 数字示波器是数据采集,A/D转换,软件编程等一系列的技术制造出来的高性能示波器。显示效果不如模拟示波器,但是带宽大,功能丰富,已经成为测试的主流。-Digital oscilloscope is a data acquisition, A/D conversion, software programming, a series of technology to produce high performance oscilloscope. The display effect is not as
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:15.78mb
    • 提供者:吴立
  1. Digital_Signal_Integrity

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  2. Book on PCB digital signal integrity issues.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.79mb
    • 提供者:_Aquarius_
  1. dtrigger

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  2. 分频器,对输入时钟进行分频,可以用来驱动电机,或者用作其他需要时钟源的外设的驱动信号-Divider, devide the input clock frequency to another frequence clock signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.8mb
    • 提供者:wxl
  1. sgmii_latest[1].tar

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  2. 这个工程应用于千兆网传输的物理代码子层,同时也用于SGMII接口。两者不同之处是自动协商时链接定时器和控制信息。-This core implements Physical Coding Sublayer of 1000BaseX transmission (IEEE 802.3 Clause36 and 37). This core can also be used for SGMII interface as this interface leverages 1000BaseX PCS.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.8mb
    • 提供者:hejun
  1. gpmc

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  2. GPMC模块源代码。适合初学者的FPGA学习。-GPMC module source code. FPGA for beginners to learn.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-30
    • 文件大小:15.82mb
    • 提供者:daizunchao
  1. DDR3_controler

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  2. s6和k7 fpga的ddr3 ip控制器使用说明;(S6 and K7 FPGA DDR3 IP controller use instructions)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-20
    • 文件大小:15.82mb
    • 提供者:葫芦娃的说
  1. Eng

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  2. HDL Design, verification using HDL languidges
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.82mb
    • 提供者:romanp
  1. FPGA开发实战手册 V1.1

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  2. 介绍了fpga的开发流程,对实际案例进行源码剖析,清楚易学(Introduced the FPGA development process, carries on the source code analysis to the actual case, clear is easy to learn)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-23
    • 文件大小:15.83mb
    • 提供者:大众
  1. sim

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  2. 时钟倍频后,通过Modelsim仿真验证任意占空比可调的PWM信号-After the clock multiplier, through Modelsim simulation arbitrary variable duty cycle PWM signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.84mb
    • 提供者:程维好
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